DRAM Slow Refresh
El refresco de memoria RAM por defecto ocurre cada 15 µs. Una tarjeta de 16 bit con capacidad bus
master puede activar el refresco. Seleccionando un periodo lento de refresco en este apartado
especifica la frecuencia de la petición de refresco de una tarjeta ISA.
DRAM Speculative
Leadoff
Una petición de lectura del procesador a la controladora de memoria RAM incluye la dirección de
memoria de los datos deseados. Cuando está ENABLED, este parámetro permite a la controladora
de memoria pasar a memoria el comando de lectura antes de haber descodificado totalmente la
dirección de memoria, acelerando así el proceso de lectura.
DRAM Speed Selection
El valor de este campo debe corresponder a la velocidad de la memoria RAM instalada en el equipo.
NO cambiar los valores por defecto de este campo que han sido determinados por el fabricante de la
placa para la RAM instalada. Este valor es la velocidad de acceso, por tanto un valor menor implica
un equipo más rápido.
DRAM Timing
El valor de este parámetro depende de la velocidad de los chips de memoria RAM instalada. Para
aumentar las prestaciones del sistema, se puede escoger 60ns (nanosegundos) en caso de tener
instalada en el sistema memoria RAM de tipo EDO o memoria de tipo FPM (Fast Page Mode) de
60ns. Si se producen errores de memoria o el sistema se cuelga con cierta frecuencia, se debe
escoger 70ns.
DRAM Timing Control
Esto permite al usuario establecer los ciclos de reloj del sistema al leer o escribir a memoria.
DRAM to PCI RSLP
Cuando está ENABLED, the chipset permite el adelanto de dos líneas de datos de la memoria del
sistema al bus PCI
DRAM Write Burst
(B/E/F)
DRAM Write Burst
Timing
Establece los ciclos de reloj para las escrituras a memoria RAM en modo ráfaga. A menor número,
más rápido se comunica el sistema con la memoria. Seleccionar ciclos de reloj menores que los que
soporta la memoria RAM instalada da lugar a errores de memoria.
DRAM Write Wait State
El diseñador de la placa base puede decidir insertar un estado de espera en el ciclo de escritura de
memoria, si es necesario.
DREQ6 PIN as
Este apartado permite al fabricante de la placa base invocar una rutina de ahorro de energía por
software usando la señal DREQ6. Seleccionar SUSPEND SW sólo si la placa base soporta esta
característica
Selecciona las especificaciones correctas para la unidad de diskette instalada en el equipo
None
Sin disketera
360K, 5.25 in
Disketera de 51/4 de baja densidad; 360k de capacidad
1.2M, 5.25 in
Disketera de 51/4 de alta densidad; 1.2 megabyte de capacidad
720K, 3.5 in
Disketera de 31/2 de doble cara; 720k de capacidad
1.44M, 3.5 in
Disketera de 31/2 de doble cara; 1.44 megabyte de capacidad
Drive A
Drive B
2.88M, 3.5 in
Disketera de 31/2 de doble cara; 2.88 megabyte de capacidad
Drive NA before BRDY
Cuando está ENABLED, la señal NA tiene lugar un ciclo de reloj antes de la última BRDY# de
cada ciclo para los ciclos de lectura/escritura, generando así una ADS# en el ciclo siguiente después
de la BRDY#, eliminando un ciclo muerto.
DRQ Detection
Cuando está ENABLED, cualquier actividad en una línea de señal DRQ despierta el sistema o pone
a cero el temporizador de inactividad
Duplex Select
Este parámetro aparece en un modo de puerto de infrarrojos. El modo FULL DUPLEX permite la
transmisión simultánea en ambas direcciones. El modo HALF DUPLEX permite la transmisión en
una dirección de cada vez. Hay que seleccionar el valor requerido por el dispositivo de infrarrojos
conectado al puerto de infrarrojos.
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